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Systemverilog
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Systemverilog
// Copyright lowRISC contributors.
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// Copyright 2017 ETH Zurich and University of Bologna.
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// Licensed under the Apache License, Version 2.0, see LICENSE for details.
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// SPDX-License-Identifier: Apache-2.0
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package ibex_tracer_defines;
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import ibex_defines::*;
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// instruction masks (for tracer)
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// parameter INSTR_CUSTOM0 = { 25'b?, OPCODE_CUST0 };
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// parameter INSTR_CUSTOM1 = { 25'b?, OPCODE_CUST1 };
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parameter INSTR_LUI = { 25'b?, OPCODE_LUI };
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parameter INSTR_AUIPC = { 25'b?, OPCODE_AUIPC };
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parameter INSTR_JAL = { 25'b?, OPCODE_JAL };
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parameter INSTR_JALR = { 17'b?, 3'b000, 5'b?, OPCODE_JALR };
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// BRANCH
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parameter INSTR_BEQ = { 17'b?, 3'b000, 5'b?, OPCODE_BRANCH };
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parameter INSTR_BNE = { 17'b?, 3'b001, 5'b?, OPCODE_BRANCH };
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parameter INSTR_BLT = { 17'b?, 3'b100, 5'b?, OPCODE_BRANCH };
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parameter INSTR_BGE = { 17'b?, 3'b101, 5'b?, OPCODE_BRANCH };
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parameter INSTR_BLTU = { 17'b?, 3'b110, 5'b?, OPCODE_BRANCH };
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parameter INSTR_BGEU = { 17'b?, 3'b111, 5'b?, OPCODE_BRANCH };
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parameter INSTR_BALL = { 17'b?, 3'b010, 5'b?, OPCODE_BRANCH };
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// OPIMM
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parameter INSTR_ADDI = { 17'b?, 3'b000, 5'b?, OPCODE_OPIMM };
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parameter INSTR_SLTI = { 17'b?, 3'b010, 5'b?, OPCODE_OPIMM };
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parameter INSTR_SLTIU = { 17'b?, 3'b011, 5'b?, OPCODE_OPIMM };
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parameter INSTR_XORI = { 17'b?, 3'b100, 5'b?, OPCODE_OPIMM };
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parameter INSTR_ORI = { 17'b?, 3'b110, 5'b?, OPCODE_OPIMM };
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parameter INSTR_ANDI = { 17'b?, 3'b111, 5'b?, OPCODE_OPIMM };
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parameter INSTR_SLLI = { 7'b0000000, 10'b?, 3'b001, 5'b?, OPCODE_OPIMM };
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parameter INSTR_SRLI = { 7'b0000000, 10'b?, 3'b101, 5'b?, OPCODE_OPIMM };
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parameter INSTR_SRAI = { 7'b0100000, 10'b?, 3'b101, 5'b?, OPCODE_OPIMM };
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// OP
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parameter INSTR_ADD = { 7'b0000000, 10'b?, 3'b000, 5'b?, OPCODE_OP };
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parameter INSTR_SUB = { 7'b0100000, 10'b?, 3'b000, 5'b?, OPCODE_OP };
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parameter INSTR_SLL = { 7'b0000000, 10'b?, 3'b001, 5'b?, OPCODE_OP };
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parameter INSTR_SLT = { 7'b0000000, 10'b?, 3'b010, 5'b?, OPCODE_OP };
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parameter INSTR_SLTU = { 7'b0000000, 10'b?, 3'b011, 5'b?, OPCODE_OP };
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parameter INSTR_XOR = { 7'b0000000, 10'b?, 3'b100, 5'b?, OPCODE_OP };
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parameter INSTR_SRL = { 7'b0000000, 10'b?, 3'b101, 5'b?, OPCODE_OP };
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parameter INSTR_SRA = { 7'b0100000, 10'b?, 3'b101, 5'b?, OPCODE_OP };
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parameter INSTR_OR = { 7'b0000000, 10'b?, 3'b110, 5'b?, OPCODE_OP };
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parameter INSTR_AND = { 7'b0000000, 10'b?, 3'b111, 5'b?, OPCODE_OP };
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// SYSTEM
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parameter INSTR_CSRRW = { 17'b?, 3'b001, 5'b?, OPCODE_SYSTEM };
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parameter INSTR_CSRRS = { 17'b?, 3'b010, 5'b?, OPCODE_SYSTEM };
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parameter INSTR_CSRRC = { 17'b?, 3'b011, 5'b?, OPCODE_SYSTEM };
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parameter INSTR_CSRRWI = { 17'b?, 3'b101, 5'b?, OPCODE_SYSTEM };
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parameter INSTR_CSRRSI = { 17'b?, 3'b110, 5'b?, OPCODE_SYSTEM };
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parameter INSTR_CSRRCI = { 17'b?, 3'b111, 5'b?, OPCODE_SYSTEM };
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parameter INSTR_ECALL = { 12'b000000000000, 13'b0, OPCODE_SYSTEM };
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parameter INSTR_EBREAK = { 12'b000000000001, 13'b0, OPCODE_SYSTEM };
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parameter INSTR_MRET = { 12'b001100000010, 13'b0, OPCODE_SYSTEM };
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parameter INSTR_WFI = { 12'b000100000101, 13'b0, OPCODE_SYSTEM };
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// RV32M
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parameter INSTR_DIV = { 7'b0000001, 10'b?, 3'b100, 5'b?, OPCODE_OP };
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parameter INSTR_DIVU = { 7'b0000001, 10'b?, 3'b101, 5'b?, OPCODE_OP };
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parameter INSTR_REM = { 7'b0000001, 10'b?, 3'b110, 5'b?, OPCODE_OP };
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parameter INSTR_REMU = { 7'b0000001, 10'b?, 3'b111, 5'b?, OPCODE_OP };
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parameter INSTR_PMUL = { 7'b0000001, 10'b?, 3'b000, 5'b?, OPCODE_OP };
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parameter INSTR_PMUH = { 7'b0000001, 10'b?, 3'b001, 5'b?, OPCODE_OP };
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parameter INSTR_PMULHSU = { 7'b0000001, 10'b?, 3'b010, 5'b?, OPCODE_OP };
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parameter INSTR_PMULHU = { 7'b0000001, 10'b?, 3'b011, 5'b?, OPCODE_OP };
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endpackage |